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Formation SystemC et Transaction Level Modeling (TLM) – Introduction
Domaine : Développement et méthodes
DURÉE
3 jour(s)
OBJECTIFS
Modélisations des "blocks" (Ips) et des "systèmes semi-conducteurs complexes" (System on Chip). Apprentissage et expérimentation avec SystemC, TLM/Virtual Prototyping à plusieurs niveaux d'abstraction.
Pré-requis
Expérience en la conception microelectronique (ASIC ou FPGA) et/ou les concepts généraux de design et vérification. Connaissance de VHDL ou Verilog. Expérience avec un simulateur HDL. Connaissance générale d'un langage informatique mieux si orienté-objet
Participants
Ingénieur (HW et SW), architecte et chef de projet concerné par la conception, l'étude, l'optimisation et la vérification des Ips et Systems on Chip.
coût
Formation en cours collectif
Tarif par personne : 1500 € HT
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LIEUx de formation
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PROGRAMME DE FORMATION
SystemC et Transaction Level Modeling (TLM) – Introduction
SystemC : concepts principaux
Les éléments essentiels du C++ et de la programmation orienté-objet pour le SystemC
La modélisation des sytèmes semi-conducteur : concepts de base
Introduction au Transaction Level Modeling (TLM)
La modélisation des sytèmes semi-conducteur : concepts de base
Introduction au Transaction Level Modeling (TLM)
SystemC : le langage
Modules / threads / events / ports / interfaces / channels
Travaux pratiques : Modélisation fonctionnelle even-based d'un design simple (2h/3h)
Travaux pratiques : Modélisation fonctionnelle even-based d'un design simple (2h/3h)
Modélisation TLM
TLM2 Transport layer
Travaux pratiques : Modélisation Master/Slave TLM2 (3h)
Travaux pratiques : Modélisation Master/Slave TLM2 (3h)
Modélisation Système/Prototypage Virtuel (untimed/loosely timed)
ISS / Host Code / Co-Simulation / Co-Verification
Travaux Pratiques : Intégration d'un modèle TLM2 dans une Plateforme Virtuelle (2h/3h)
Travaux Pratiques : Intégration d'un modèle TLM2 dans une Plateforme Virtuelle (2h/3h)
Bus Cycle Accurate Modeling (approximately timed)
Exploration architecturale
Travaux Pratiques : Modélisation au niveau Bus Cycle Accurate (3h)
Travaux Pratiques : Modélisation au niveau Bus Cycle Accurate (3h)
Applications supplémentaires de SystemC
Co-vérification Hardware / Software
Travaux Pratiques : Co-simulation et co-vérification SystemC TLM (SystemC) / RTL (HDL) (2h/3h)
Travaux Pratiques : Co-simulation et co-vérification SystemC TLM (SystemC) / RTL (HDL) (2h/3h)
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